Early SiS 50x rework
Rewrote the chipset to adopt the new API
This commit is contained in:
Panagiotis
GitHub
@@ -6,436 +6,264 @@
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* This file is part of the 86Box distribution.
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* This file is part of the 86Box distribution.
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* Implementation of the SiS 85c501/85c503 chip.
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* Implementation of the SiS 85C50x Chipset.
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* Authors: Sarah Walker, <http://pcem-emulator.co.uk/>
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* Authors: Tiseno100,
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* Miran Grca, <mgrca8@gmail.com>
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* Copyright 2019 Miran Grca.
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* Copyright 2020 Tiseno100.
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*/
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*/
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#include <stdio.h>
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#include <stdio.h>
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#include <stdint.h>
|
#include <stdint.h>
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#include <stdlib.h>
|
#include <stdlib.h>
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#include <string.h>
|
#include <string.h>
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#include <wchar.h>
|
#include <wchar.h>
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#include <86box/86box.h>
|
#include <86box/86box.h>
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#include <86box/mem.h>
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#include <86box/io.h>
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#include <86box/rom.h>
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#include <86box/pci.h>
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||||||
#include <86box/device.h>
|
#include <86box/device.h>
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#include <86box/keyboard.h>
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#include <86box/io.h>
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#include <86box/port_92.h>
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#include <86box/timer.h>
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#include <86box/apm.h>
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#include <86box/mem.h>
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#include <86box/smram.h>
|
||||||
|
#include <86box/pci.h>
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||||||
#include <86box/chipset.h>
|
#include <86box/chipset.h>
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#ifdef ENABLE_SIS_85C50X_LOG
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||||||
typedef struct sis_85c501_t
|
int sis_85c50x_do_log = ENABLE_SIS_85C50X_LOG;
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static void
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||||||
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sis_85c50x_log(const char *fmt, ...)
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{
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{
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/* 85c501 */
|
va_list ap;
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uint8_t turbo_reg;
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/* 85c503 */
|
if (sis_85c50x_do_log)
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|
{
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||||||
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va_start(ap, fmt);
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pclog_ex(fmt, ap);
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va_end(ap);
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}
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||||||
|
}
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||||||
|
#else
|
||||||
|
#define sis_85c50x_log(fmt, ...)
|
||||||
|
#endif
|
||||||
|
|
||||||
/* Registers */
|
typedef struct sis_85c50x_t
|
||||||
uint8_t pci_conf[2][256];
|
{
|
||||||
|
uint8_t pci_conf[256], pci_conf_sb[256];
|
||||||
|
|
||||||
/* 85c50x ISA */
|
apm_t *apm;
|
||||||
uint8_t cur_reg,
|
smram_t *smram;
|
||||||
regs[39];
|
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||||||
} sis_85c50x_t;
|
} sis_85c50x_t;
|
||||||
|
|
||||||
|
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||||||
static void
|
static void
|
||||||
sis_85c501_recalcmapping(sis_85c50x_t *dev)
|
sis_85c50x_shadow_recalc(sis_85c50x_t *dev)
|
||||||
{
|
{
|
||||||
int c, d;
|
uint32_t base, i, can_read, can_write;
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||||||
uint32_t base;
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||||||
|
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||||||
for (c = 0; c < 1; c++) {
|
can_read = (dev->pci_conf[0x53] & 0x40) ? MEM_READ_INTERNAL : MEM_READ_EXTANY;
|
||||||
for (d = 0; d < 4; d++) {
|
can_write = (dev->pci_conf[0x53] & 0x20) ? MEM_WRITE_EXTANY : MEM_WRITE_INTERNAL;
|
||||||
base = 0xe0000 + (d << 14);
|
|
||||||
if (dev->pci_conf[0][0x54 + c] & (1 << (d + 4))) {
|
mem_set_mem_state_both(0xf0000, 0x10000, can_read | can_write);
|
||||||
switch (dev->pci_conf[0][0x53] & 0x60) {
|
|
||||||
case 0x00:
|
for (i = 0; i < 4; i++)
|
||||||
mem_set_mem_state(base, 0x4000, MEM_READ_EXTANY | MEM_WRITE_INTERNAL);
|
{
|
||||||
break;
|
base = 0xd0000 - ((i + 1) << 14);
|
||||||
case 0x20:
|
mem_set_mem_state_both(base, 0x4000, (dev->pci_conf[0x56] & (1 << (i + 4))) ? (can_read | can_write) : (MEM_READ_EXTANY | MEM_WRITE_EXTANY));
|
||||||
mem_set_mem_state(base, 0x4000, MEM_READ_EXTANY | MEM_WRITE_EXTANY);
|
mem_set_mem_state_both(base + 0x10000, 0x4000, (dev->pci_conf[0x55] & (1 << (i + 4))) ? (can_read | can_write) : (MEM_READ_EXTANY | MEM_WRITE_EXTANY));
|
||||||
break;
|
mem_set_mem_state_both(base + 0x20000, 0x4000, (dev->pci_conf[0x54] & (1 << (i + 4))) ? (can_read | can_write) : (MEM_READ_EXTANY | MEM_WRITE_EXTANY));
|
||||||
case 0x40:
|
|
||||||
mem_set_mem_state(base, 0x4000, MEM_READ_INTERNAL | MEM_WRITE_INTERNAL);
|
|
||||||
break;
|
|
||||||
case 0x60:
|
|
||||||
mem_set_mem_state(base, 0x4000, MEM_READ_INTERNAL | MEM_WRITE_EXTANY);
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
} else
|
|
||||||
mem_set_mem_state(base, 0x4000, MEM_READ_EXTANY | MEM_WRITE_EXTANY);
|
|
||||||
}
|
}
|
||||||
}
|
flushmmucache();
|
||||||
|
|
||||||
flushmmucache();
|
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||||||
shadowbios = 1;
|
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||||||
}
|
}
|
||||||
|
|
||||||
|
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||||||
static void
|
static void
|
||||||
sis_85c501_write(int func, int addr, uint8_t val, void *priv)
|
sis_85c50x_smm_recalc(sis_85c50x_t *dev)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
//Note: Host Address determination is unclear
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||||||
|
switch ((dev->pci_conf[0x65] & 0xe0) >> 5)
|
||||||
if (func)
|
{
|
||||||
return;
|
case 0x00:
|
||||||
|
if (dev->pci_conf[0x54] == 0x00)
|
||||||
if ((addr >= 0x10) && (addr < 0x4f))
|
smram_enable(dev->smram, 0xa0000, 0xe0000, 0x10000, (dev->pci_conf[0x65] & 0x10), 1);
|
||||||
return;
|
|
||||||
|
|
||||||
switch (addr) {
|
|
||||||
case 0x00: case 0x01: case 0x02: case 0x03:
|
|
||||||
case 0x08: case 0x09: case 0x0a: case 0x0b:
|
|
||||||
case 0x0c: case 0x0e:
|
|
||||||
return;
|
|
||||||
|
|
||||||
case 0x04: /*Command register*/
|
|
||||||
val &= 0x42;
|
|
||||||
val |= 0x04;
|
|
||||||
break;
|
break;
|
||||||
case 0x05:
|
case 0x01:
|
||||||
val &= 0x01;
|
smram_enable(dev->smram, 0xa0000, 0xb0000, 0x10000, (dev->pci_conf[0x65] & 0x10), 1);
|
||||||
break;
|
break;
|
||||||
|
case 0x02:
|
||||||
case 0x06: /*Status*/
|
smram_enable(dev->smram, 0xa0000, 0xa0000, 0x10000, (dev->pci_conf[0x65] & 0x10), 1);
|
||||||
val = 0;
|
|
||||||
break;
|
break;
|
||||||
case 0x07:
|
case 0x04:
|
||||||
val = 0x02;
|
smram_enable(dev->smram, 0xa0000, 0xa0000, 0x8000, (dev->pci_conf[0x65] & 0x10), 1);
|
||||||
break;
|
break;
|
||||||
|
case 0x06:
|
||||||
case 0x54: /*Shadow configure*/
|
smram_enable(dev->smram, 0xa0000, 0xb0000, 0x8000, (dev->pci_conf[0x65] & 0x10), 1);
|
||||||
if ((dev->pci_conf[0][0x54] & val) ^ 0xf0) {
|
|
||||||
dev->pci_conf[0][0x54] = val;
|
|
||||||
sis_85c501_recalcmapping(dev);
|
|
||||||
}
|
|
||||||
break;
|
break;
|
||||||
}
|
}
|
||||||
|
|
||||||
dev->pci_conf[0][addr] = val;
|
|
||||||
}
|
}
|
||||||
|
|
||||||
|
static void
|
||||||
|
sis_85c50x_write(int func, int addr, uint8_t val, void *priv)
|
||||||
|
{
|
||||||
|
|
||||||
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
|
|
||||||
|
dev->pci_conf[addr] = val;
|
||||||
|
switch (addr)
|
||||||
|
{
|
||||||
|
case 0x51:
|
||||||
|
cpu_cache_ext_enabled = (val & 0x40);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case 0x53:
|
||||||
|
case 0x54:
|
||||||
|
case 0x55:
|
||||||
|
case 0x56:
|
||||||
|
sis_85c50x_shadow_recalc(dev);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case 0x60:
|
||||||
|
apm_set_do_smi(dev->apm, (val & 0x02));
|
||||||
|
break;
|
||||||
|
|
||||||
|
case 0x64:
|
||||||
|
case 0x65:
|
||||||
|
sis_85c50x_smm_recalc(dev);
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
sis_85c50x_log("85C501: dev->pci_conf[%02x] = %02x", addr, val);
|
||||||
|
}
|
||||||
|
|
||||||
|
static uint8_t
|
||||||
|
sis_85c50x_read(int func, int addr, void *priv)
|
||||||
|
{
|
||||||
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
|
sis_85c50x_log("85C501: dev->pci_conf[%02x] (%02x)", addr, dev->pci_conf[addr]);
|
||||||
|
return dev->pci_conf[addr];
|
||||||
|
}
|
||||||
|
|
||||||
static void
|
static void
|
||||||
sis_85c503_write(int func, int addr, uint8_t val, void *priv)
|
sis_85c50x_sb_write(int func, int addr, uint8_t val, void *priv)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
|
||||||
|
|
||||||
if (func > 0)
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
return;
|
|
||||||
|
|
||||||
if (addr >= 0x0f && addr < 0x41)
|
dev->pci_conf_sb[addr] = val;
|
||||||
return;
|
|
||||||
|
|
||||||
switch(addr) {
|
|
||||||
case 0x00: case 0x01: case 0x02: case 0x03:
|
|
||||||
case 0x08: case 0x09: case 0x0a: case 0x0b:
|
|
||||||
case 0x0e:
|
|
||||||
return;
|
|
||||||
|
|
||||||
case 0x04: /*Command register*/
|
|
||||||
val &= 0x08;
|
|
||||||
val |= 0x07;
|
|
||||||
break;
|
|
||||||
case 0x05:
|
|
||||||
val = 0;
|
|
||||||
break;
|
|
||||||
|
|
||||||
case 0x06: /*Status*/
|
|
||||||
val = 0;
|
|
||||||
break;
|
|
||||||
case 0x07:
|
|
||||||
val = 0x02;
|
|
||||||
break;
|
|
||||||
|
|
||||||
|
switch (addr)
|
||||||
|
{
|
||||||
case 0x41:
|
case 0x41:
|
||||||
if (val & 0x80)
|
pci_set_irq_routing(PCI_INTA, (val & 0x80) ? (val & 0x0f) : PCI_IRQ_DISABLED);
|
||||||
pci_set_irq_routing(PCI_INTA, PCI_IRQ_DISABLED);
|
|
||||||
else
|
|
||||||
pci_set_irq_routing(PCI_INTA, val & 0xf);
|
|
||||||
break;
|
break;
|
||||||
case 0x42:
|
case 0x42:
|
||||||
if (val & 0x80)
|
pci_set_irq_routing(PCI_INTB, (val & 0x80) ? (val & 0x0f) : PCI_IRQ_DISABLED);
|
||||||
pci_set_irq_routing(PCI_INTC, PCI_IRQ_DISABLED);
|
|
||||||
else
|
|
||||||
pci_set_irq_routing(PCI_INTC, val & 0xf);
|
|
||||||
break;
|
break;
|
||||||
case 0x43:
|
case 0x43:
|
||||||
if (val & 0x80)
|
pci_set_irq_routing(PCI_INTC, (val & 0x80) ? (val & 0x0f) : PCI_IRQ_DISABLED);
|
||||||
pci_set_irq_routing(PCI_INTB, PCI_IRQ_DISABLED);
|
|
||||||
else
|
|
||||||
pci_set_irq_routing(PCI_INTB, val & 0xf);
|
|
||||||
break;
|
break;
|
||||||
case 0x44:
|
case 0x44:
|
||||||
if (val & 0x80)
|
pci_set_irq_routing(PCI_INTD, (val & 0x80) ? (val & 0x0f) : PCI_IRQ_DISABLED);
|
||||||
pci_set_irq_routing(PCI_INTD, PCI_IRQ_DISABLED);
|
|
||||||
else
|
|
||||||
pci_set_irq_routing(PCI_INTD, val & 0xf);
|
|
||||||
break;
|
break;
|
||||||
}
|
}
|
||||||
|
sis_85c50x_log("85C503: dev->pci_conf_sb[%02x] = %02x", addr, val);
|
||||||
dev->pci_conf[1][addr] = val;
|
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
||||||
static void
|
|
||||||
sis_85c50x_isa_write(uint16_t port, uint8_t val, void *priv)
|
|
||||||
{
|
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
|
||||||
|
|
||||||
if (port & 1) {
|
|
||||||
if (dev->cur_reg <= 0x1a)
|
|
||||||
dev->regs[dev->cur_reg] = val;
|
|
||||||
} else
|
|
||||||
dev->cur_reg = val;
|
|
||||||
}
|
|
||||||
|
|
||||||
|
|
||||||
static uint8_t
|
static uint8_t
|
||||||
sis_85c501_read(int func, int addr, void *priv)
|
sis_85c50x_sb_read(int func, int addr, void *priv)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
|
sis_85c50x_log("85C503: dev->pci_conf_sb[%02x] (%02x)", addr, dev->pci_conf_sb[addr]);
|
||||||
if (func)
|
return dev->pci_conf_sb[addr];
|
||||||
return 0xff;
|
|
||||||
|
|
||||||
return dev->pci_conf[0][addr];
|
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
||||||
static uint8_t
|
|
||||||
sis_85c503_read(int func, int addr, void *priv)
|
|
||||||
{
|
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
|
||||||
|
|
||||||
if (func > 0)
|
|
||||||
return 0xff;
|
|
||||||
|
|
||||||
return dev->pci_conf[1][addr];
|
|
||||||
}
|
|
||||||
|
|
||||||
|
|
||||||
static uint8_t
|
|
||||||
sis_85c50x_isa_read(uint16_t port, void *priv)
|
|
||||||
{
|
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
|
||||||
|
|
||||||
if (port & 1) {
|
|
||||||
if (dev->cur_reg <= 0x1a)
|
|
||||||
return dev->regs[dev->cur_reg];
|
|
||||||
else
|
|
||||||
return 0xff;
|
|
||||||
} else
|
|
||||||
return dev->cur_reg;
|
|
||||||
}
|
|
||||||
|
|
||||||
|
|
||||||
static void
|
|
||||||
sis_85c50x_isa_reset(sis_85c50x_t *dev)
|
|
||||||
{
|
|
||||||
int mem_size_mb, i = 0;
|
|
||||||
|
|
||||||
memset(dev->regs, 0, sizeof(dev->regs));
|
|
||||||
|
|
||||||
dev->cur_reg = 0;
|
|
||||||
for (i = 0; i < 0x27; i++)
|
|
||||||
dev->regs[i] = 0x00;
|
|
||||||
|
|
||||||
dev->regs[9] = 0x40;
|
|
||||||
|
|
||||||
mem_size_mb = mem_size >> 10;
|
|
||||||
switch (mem_size_mb) {
|
|
||||||
case 0: case 1:
|
|
||||||
dev->regs[9] |= 0;
|
|
||||||
break;
|
|
||||||
case 2: case 3:
|
|
||||||
dev->regs[9] |= 1;
|
|
||||||
break;
|
|
||||||
case 4:
|
|
||||||
dev->regs[9] |= 2;
|
|
||||||
break;
|
|
||||||
case 5:
|
|
||||||
dev->regs[9] |= 0x20;
|
|
||||||
break;
|
|
||||||
case 6: case 7:
|
|
||||||
dev->regs[9] |= 9;
|
|
||||||
break;
|
|
||||||
case 8: case 9:
|
|
||||||
dev->regs[9] |= 4;
|
|
||||||
break;
|
|
||||||
case 10: case 11:
|
|
||||||
dev->regs[9] |= 5;
|
|
||||||
break;
|
|
||||||
case 12: case 13: case 14: case 15:
|
|
||||||
dev->regs[9] |= 0xB;
|
|
||||||
break;
|
|
||||||
case 16:
|
|
||||||
dev->regs[9] |= 0x13;
|
|
||||||
break;
|
|
||||||
case 17:
|
|
||||||
dev->regs[9] |= 0x21;
|
|
||||||
break;
|
|
||||||
case 18: case 19:
|
|
||||||
dev->regs[9] |= 6;
|
|
||||||
break;
|
|
||||||
case 20: case 21: case 22: case 23:
|
|
||||||
dev->regs[9] |= 0xD;
|
|
||||||
break;
|
|
||||||
case 24: case 25: case 26: case 27:
|
|
||||||
case 28: case 29: case 30: case 31:
|
|
||||||
dev->regs[9] |= 0xE;
|
|
||||||
break;
|
|
||||||
case 32: case 33: case 34: case 35:
|
|
||||||
dev->regs[9] |= 0x1B;
|
|
||||||
break;
|
|
||||||
case 36: case 37: case 38: case 39:
|
|
||||||
dev->regs[9] |= 0xF;
|
|
||||||
break;
|
|
||||||
case 40: case 41: case 42: case 43:
|
|
||||||
case 44: case 45: case 46: case 47:
|
|
||||||
dev->regs[9] |= 0x17;
|
|
||||||
break;
|
|
||||||
case 48:
|
|
||||||
dev->regs[9] |= 0x1E;
|
|
||||||
break;
|
|
||||||
default:
|
|
||||||
if (mem_size_mb < 64)
|
|
||||||
dev->regs[9] |= 0x1E;
|
|
||||||
else if ((mem_size_mb >= 65) && (mem_size_mb < 68))
|
|
||||||
dev->regs[9] |= 0x22;
|
|
||||||
else
|
|
||||||
dev->regs[9] |= 0x24;
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
dev->regs[0x11] = 9;
|
|
||||||
dev->regs[0x12] = 0xFF;
|
|
||||||
dev->regs[0x23] = 0xF0;
|
|
||||||
dev->regs[0x26] = 1;
|
|
||||||
|
|
||||||
io_removehandler(0x22, 0x0002,
|
|
||||||
sis_85c50x_isa_read, NULL, NULL, sis_85c50x_isa_write, NULL, NULL, dev);
|
|
||||||
io_sethandler(0x22, 0x0002,
|
|
||||||
sis_85c50x_isa_read, NULL, NULL, sis_85c50x_isa_write, NULL, NULL, dev);
|
|
||||||
}
|
|
||||||
|
|
||||||
|
|
||||||
static void
|
static void
|
||||||
sis_85c50x_reset(void *priv)
|
sis_85c50x_reset(void *priv)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
|
|
||||||
uint8_t val = 0;
|
/* North Bridge */
|
||||||
|
dev->pci_conf[0x00] = 0x39;
|
||||||
|
dev->pci_conf[0x01] = 0x10;
|
||||||
|
dev->pci_conf[0x02] = 0x06;
|
||||||
|
dev->pci_conf[0x03] = 0x04;
|
||||||
|
dev->pci_conf[0x04] = 0x04;
|
||||||
|
dev->pci_conf[0x05] = 0x00;
|
||||||
|
dev->pci_conf[0x06] = 0x00;
|
||||||
|
dev->pci_conf[0x07] = 0x00;
|
||||||
|
dev->pci_conf[0x08] = 0x00;
|
||||||
|
dev->pci_conf[0x09] = 0x00;
|
||||||
|
dev->pci_conf[0x0a] = 0x00;
|
||||||
|
dev->pci_conf[0x0b] = 0x06;
|
||||||
|
dev->pci_conf[0x0c] = 0x00;
|
||||||
|
dev->pci_conf[0x0d] = 0x00;
|
||||||
|
dev->pci_conf[0x0e] = 0x00;
|
||||||
|
dev->pci_conf[0x0f] = 0x00;
|
||||||
|
|
||||||
val = sis_85c501_read(0, 0x54, priv); /* Read current value of 0x44. */
|
sis_85c50x_write(0, 0x51, 0x00, dev);
|
||||||
sis_85c501_write(0, 0x54, val & 0xf, priv); /* Turn off shadow BIOS but keep the lower 4 bits. */
|
sis_85c50x_write(0, 0x53, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x54, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x55, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x56, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x60, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x64, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x65, 0x00, dev);
|
||||||
|
|
||||||
sis_85c50x_isa_reset(dev);
|
/* South Bridge */
|
||||||
|
dev->pci_conf_sb[0x00] = 0x39;
|
||||||
|
dev->pci_conf_sb[0x01] = 0x10;
|
||||||
|
dev->pci_conf_sb[0x02] = 0x08;
|
||||||
|
dev->pci_conf_sb[0x03] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x04] = 0x07;
|
||||||
|
dev->pci_conf_sb[0x05] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x06] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x07] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x08] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x09] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x0a] = 0x01;
|
||||||
|
dev->pci_conf_sb[0x0b] = 0x06;
|
||||||
|
dev->pci_conf_sb[0x0c] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x0d] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x0e] = 0x00;
|
||||||
|
dev->pci_conf_sb[0x0f] = 0x00;
|
||||||
|
sis_85c50x_write(0, 0x41, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x42, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x43, 0x00, dev);
|
||||||
|
sis_85c50x_write(0, 0x44, 0x00, dev);
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
||||||
static void
|
|
||||||
sis_85c50x_setup(sis_85c50x_t *dev)
|
|
||||||
{
|
|
||||||
memset(dev, 0, sizeof(sis_85c50x_t));
|
|
||||||
|
|
||||||
/* 85c501 */
|
|
||||||
dev->pci_conf[0][0x00] = 0x39; /*SiS*/
|
|
||||||
dev->pci_conf[0][0x01] = 0x10;
|
|
||||||
dev->pci_conf[0][0x02] = 0x06; /*501/502*/
|
|
||||||
dev->pci_conf[0][0x03] = 0x04;
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x04] = 7;
|
|
||||||
dev->pci_conf[0][0x05] = 0;
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x06] = 0x80;
|
|
||||||
dev->pci_conf[0][0x07] = 0x02;
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x08] = 0; /*Device revision*/
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x09] = 0x00; /*Device class (PCI bridge)*/
|
|
||||||
dev->pci_conf[0][0x0a] = 0x00;
|
|
||||||
dev->pci_conf[0][0x0b] = 0x06;
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x0e] = 0x00; /*Single function device*/
|
|
||||||
|
|
||||||
dev->pci_conf[0][0x50] = 0xbc;
|
|
||||||
dev->pci_conf[0][0x51] = 0xfb;
|
|
||||||
dev->pci_conf[0][0x52] = 0xad;
|
|
||||||
dev->pci_conf[0][0x53] = 0xfe;
|
|
||||||
|
|
||||||
shadowbios = 1;
|
|
||||||
|
|
||||||
/* 85c503 */
|
|
||||||
dev->pci_conf[1][0x00] = 0x39; /*SiS*/
|
|
||||||
dev->pci_conf[1][0x01] = 0x10;
|
|
||||||
dev->pci_conf[1][0x02] = 0x08; /*503*/
|
|
||||||
dev->pci_conf[1][0x03] = 0x00;
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x04] = 7;
|
|
||||||
dev->pci_conf[1][0x05] = 0;
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x06] = 0x80;
|
|
||||||
dev->pci_conf[1][0x07] = 0x02;
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x08] = 0; /*Device revision*/
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x09] = 0x00; /*Device class (PCI bridge)*/
|
|
||||||
dev->pci_conf[1][0x0a] = 0x01;
|
|
||||||
dev->pci_conf[1][0x0b] = 0x06;
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x0e] = 0x00; /*Single function device*/
|
|
||||||
|
|
||||||
dev->pci_conf[1][0x41] = dev->pci_conf[1][0x42] =
|
|
||||||
dev->pci_conf[1][0x43] = dev->pci_conf[1][0x44] = 0x80;
|
|
||||||
}
|
|
||||||
|
|
||||||
|
|
||||||
static void
|
static void
|
||||||
sis_85c50x_close(void *priv)
|
sis_85c50x_close(void *priv)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) priv;
|
sis_85c50x_t *dev = (sis_85c50x_t *)priv;
|
||||||
|
|
||||||
free(dev);
|
smram_del(dev->smram);
|
||||||
|
free(dev);
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
||||||
static void *
|
static void *
|
||||||
sis_85c50x_init(const device_t *info)
|
sis_85c50x_init(const device_t *info)
|
||||||
{
|
{
|
||||||
sis_85c50x_t *dev = (sis_85c50x_t *) malloc(sizeof(sis_85c50x_t));
|
sis_85c50x_t *dev = (sis_85c50x_t *)malloc(sizeof(sis_85c50x_t));
|
||||||
|
memset(dev, 0, sizeof(sis_85c50x_t));
|
||||||
|
|
||||||
pci_add_card(0, sis_85c501_read, sis_85c501_write, dev);
|
pci_add_card(PCI_ADD_NORTHBRIDGE, sis_85c50x_read, sis_85c50x_write, dev);
|
||||||
pci_add_card(5, sis_85c503_read, sis_85c503_write, dev);
|
pci_add_card(PCI_ADD_SOUTHBRIDGE, sis_85c50x_sb_read, sis_85c50x_sb_write, dev);
|
||||||
|
dev->apm = device_add(&apm_pci_device);
|
||||||
|
dev->smram = smram_add();
|
||||||
|
sis_85c50x_reset(dev);
|
||||||
|
|
||||||
sis_85c50x_setup(dev);
|
return dev;
|
||||||
sis_85c50x_isa_reset(dev);
|
|
||||||
|
|
||||||
device_add(&port_92_pci_device);
|
|
||||||
|
|
||||||
return dev;
|
|
||||||
}
|
}
|
||||||
|
|
||||||
|
const device_t sis_85c50x_device = {
|
||||||
const device_t sis_85c50x_device =
|
"SiS 85C50x",
|
||||||
{
|
DEVICE_PCI,
|
||||||
"SiS 85c501/85c503",
|
0,
|
||||||
DEVICE_PCI,
|
sis_85c50x_init,
|
||||||
0,
|
sis_85c50x_close,
|
||||||
sis_85c50x_init,
|
sis_85c50x_reset,
|
||||||
sis_85c50x_close,
|
{NULL},
|
||||||
sis_85c50x_reset,
|
NULL,
|
||||||
{ NULL },
|
NULL,
|
||||||
NULL,
|
NULL};
|
||||||
NULL,
|
|
||||||
NULL
|
|
||||||
};
|
|
||||||
|
|||||||
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