Overhauled USB OHCI emulation, fixes NT 5.x Setup on the Atrend.
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OBattler
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src/usb.c
173
src/usb.c
@@ -27,6 +27,7 @@
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#include <86box/io.h>
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#include <86box/mem.h>
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#include <86box/usb.h>
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#include "cpu.h"
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#ifdef ENABLE_USB_LOG
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@@ -103,20 +104,180 @@ static void
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ohci_mmio_write(uint32_t addr, uint8_t val, void *p)
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{
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usb_t *dev = (usb_t *) p;
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uint8_t old;
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addr &= 0x00000fff;
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switch (addr) {
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case 0x04:
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if ((val & 0xc0) == 0x00) {
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/* UsbReset */
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dev->ohci_mmio[0x56] = dev->ohci_mmio[0x5a] = 0x16;
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}
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break;
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case 0x08: /* HCCOMMANDSTATUS */
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/* bit HostControllerReset must be cleared for the controller to be seen as initialized */
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val &= ~0x01;
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/* bit OwnershipChangeRequest triggers an ownership change (SMM <-> OS) */
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if (val & 0x0f) {
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if (val & 0x08) {
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||||
dev->ohci_mmio[0x0f] = 0x40;
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||||
dev->ohci_mmio[0x05] &= ~(dev->ohci_mmio[0x05] & 0x01);
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}
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if ((dev->ohci_mmio[0x13] & 0xc0) == 0xc0)
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smi_line = 1;
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}
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/* bit HostControllerReset must be cleared for the controller to be seen as initialized */
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if (val & 0x01) {
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memset(dev->ohci_mmio, 0x00, 4096);
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dev->ohci_mmio[0x00] = 0x10;
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dev->ohci_mmio[0x01] = 0x01;
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dev->ohci_mmio[0x48] = 0x02;
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val &= ~0x01;
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}
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break;
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case 0x0c:
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dev->ohci_mmio[addr] &= ~(val & 0x7f);
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return;
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case 0x0d: case 0x0e:
|
||||
return;
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case 0x0f:
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dev->ohci_mmio[addr] &= ~(val & 0x40);
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||||
return;
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case 0x3b:
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dev->ohci_mmio[addr] = (val & 0x80);
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||||
return;
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case 0x39: case 0x41:
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||||
dev->ohci_mmio[addr] = (val & 0x3f);
|
||||
return;
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case 0x45:
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dev->ohci_mmio[addr] = (val & 0x0f);
|
||||
return;
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case 0x3a:
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case 0x3e: case 0x3f: case 0x42: case 0x43:
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||||
case 0x46: case 0x47: case 0x48: case 0x4a:
|
||||
return;
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||||
case 0x49:
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||||
dev->ohci_mmio[addr] = (val & 0x1b);
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||||
if (val & 0x02) {
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||||
dev->ohci_mmio[0x55] |= 0x01;
|
||||
dev->ohci_mmio[0x59] |= 0x01;
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||||
}
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||||
return;
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||||
case 0x4b:
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||||
dev->ohci_mmio[addr] = (val & 0x03);
|
||||
return;
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||||
case 0x4c: case 0x4e:
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||||
dev->ohci_mmio[addr] = (val & 0x06);
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||||
if ((addr == 0x4c) && !(val & 0x04)) {
|
||||
if (!(dev->ohci_mmio[0x58] & 0x01))
|
||||
dev->ohci_mmio[0x5a] |= 0x01;
|
||||
dev->ohci_mmio[0x58] |= 0x01;
|
||||
} if ((addr == 0x4c) && !(val & 0x02)) {
|
||||
if (!(dev->ohci_mmio[0x54] & 0x01))
|
||||
dev->ohci_mmio[0x56] |= 0x01;
|
||||
dev->ohci_mmio[0x54] |= 0x01;
|
||||
}
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||||
return;
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||||
case 0x4d: case 0x4f:
|
||||
return;
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||||
case 0x50:
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||||
if (val & 0x01) {
|
||||
if ((dev->ohci_mmio[0x49] & 0x03) == 0x00) {
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||||
dev->ohci_mmio[0x55] &= ~0x01;
|
||||
dev->ohci_mmio[0x54] &= ~0x17;
|
||||
dev->ohci_mmio[0x56] &= ~0x17;
|
||||
dev->ohci_mmio[0x59] &= ~0x01;
|
||||
dev->ohci_mmio[0x58] &= ~0x17;
|
||||
dev->ohci_mmio[0x5a] &= ~0x17;
|
||||
} else if ((dev->ohci_mmio[0x49] & 0x03) == 0x01) {
|
||||
if (!(dev->ohci_mmio[0x4e] & 0x02)) {
|
||||
dev->ohci_mmio[0x55] &= ~0x01;
|
||||
dev->ohci_mmio[0x54] &= ~0x17;
|
||||
dev->ohci_mmio[0x56] &= ~0x17;
|
||||
}
|
||||
if (!(dev->ohci_mmio[0x4e] & 0x04)) {
|
||||
dev->ohci_mmio[0x59] &= ~0x01;
|
||||
dev->ohci_mmio[0x58] &= ~0x17;
|
||||
dev->ohci_mmio[0x5a] &= ~0x17;
|
||||
}
|
||||
}
|
||||
}
|
||||
return;
|
||||
case 0x51:
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||||
if (val & 0x80)
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||||
dev->ohci_mmio[addr] |= 0x80;
|
||||
return;
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||||
case 0x52:
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||||
dev->ohci_mmio[addr] &= ~(val & 0x02);
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||||
if (val & 0x01) {
|
||||
if ((dev->ohci_mmio[0x49] & 0x03) == 0x00) {
|
||||
dev->ohci_mmio[0x55] |= 0x01;
|
||||
dev->ohci_mmio[0x59] |= 0x01;
|
||||
} else if ((dev->ohci_mmio[0x49] & 0x03) == 0x01) {
|
||||
if (!(dev->ohci_mmio[0x4e] & 0x02))
|
||||
dev->ohci_mmio[0x55] |= 0x01;
|
||||
if (!(dev->ohci_mmio[0x4e] & 0x04))
|
||||
dev->ohci_mmio[0x59] |= 0x01;
|
||||
}
|
||||
}
|
||||
return;
|
||||
case 0x53:
|
||||
if (val & 0x80)
|
||||
dev->ohci_mmio[0x51] &= ~0x80;
|
||||
return;
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||||
case 0x54: case 0x58:
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||||
old = dev->ohci_mmio[addr];
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||||
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||||
if (val & 0x10) {
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||||
if (old & 0x01) {
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||||
dev->ohci_mmio[addr] |= 0x10;
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||||
/* TODO: The clear should be on a 10 ms timer. */
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||||
dev->ohci_mmio[addr] &= ~0x10;
|
||||
dev->ohci_mmio[addr + 2] |= 0x10;
|
||||
} else
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||||
dev->ohci_mmio[addr + 2] |= 0x01;
|
||||
}
|
||||
if (val & 0x08)
|
||||
dev->ohci_mmio[addr] &= ~0x04;
|
||||
if (val & 0x04)
|
||||
dev->ohci_mmio[addr] |= 0x04;
|
||||
if (val & 0x02) {
|
||||
if (old & 0x01)
|
||||
dev->ohci_mmio[addr] |= 0x02;
|
||||
else
|
||||
dev->ohci_mmio[addr + 2] |= 0x01;
|
||||
}
|
||||
if (val & 0x01) {
|
||||
if (old & 0x01)
|
||||
dev->ohci_mmio[addr] &= ~0x02;
|
||||
else
|
||||
dev->ohci_mmio[addr + 2] |= 0x01;
|
||||
}
|
||||
|
||||
if (!(dev->ohci_mmio[addr] & 0x04) && (old & 0x04))
|
||||
dev->ohci_mmio[addr + 2] |= 0x04;
|
||||
/* if (!(dev->ohci_mmio[addr] & 0x02))
|
||||
dev->ohci_mmio[addr + 2] |= 0x02; */
|
||||
return;
|
||||
case 0x55:
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||||
if ((val & 0x02) && ((dev->ohci_mmio[0x49] & 0x03) == 0x00) && (dev->ohci_mmio[0x4e] & 0x02)) {
|
||||
dev->ohci_mmio[addr] &= ~0x01;
|
||||
dev->ohci_mmio[0x54] &= ~0x17;
|
||||
dev->ohci_mmio[0x56] &= ~0x17;
|
||||
} if ((val & 0x01) && ((dev->ohci_mmio[0x49] & 0x03) == 0x00) && (dev->ohci_mmio[0x4e] & 0x02)) {
|
||||
dev->ohci_mmio[addr] |= 0x01;
|
||||
dev->ohci_mmio[0x58] &= ~0x17;
|
||||
dev->ohci_mmio[0x5a] &= ~0x17;
|
||||
}
|
||||
return;
|
||||
case 0x59:
|
||||
if ((val & 0x02) && ((dev->ohci_mmio[0x49] & 0x03) == 0x00) && (dev->ohci_mmio[0x4e] & 0x04))
|
||||
dev->ohci_mmio[addr] &= ~0x01;
|
||||
if ((val & 0x01) && ((dev->ohci_mmio[0x49] & 0x03) == 0x00) && (dev->ohci_mmio[0x4e] & 0x04))
|
||||
dev->ohci_mmio[addr] |= 0x01;
|
||||
return;
|
||||
case 0x56: case 0x5a:
|
||||
dev->ohci_mmio[addr] &= ~(val & 0x1f);
|
||||
return;
|
||||
case 0x57: case 0x5b:
|
||||
return;
|
||||
}
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||||
|
||||
dev->ohci_mmio[addr] = val;
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